hpm_soc_irq.h File Reference

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Macros
#define	IRQn_GPIO0_A   1 /* GPIO0_A IRQ */
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#define	IRQn_GPIO0_Y   6 /* GPIO0_Y IRQ */
#define	IRQn_GPIO1_A   7 /* GPIO1_A IRQ */
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#define	IRQn_GPIO1_D   10 /* GPIO1_D IRQ */
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#define	IRQn_GPTMR2   15 /* GPTMR2 IRQ */
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#define	IRQn_UART1   22 /* UART1 IRQ */
#define	IRQn_UART2   23 /* UART2 IRQ */
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#define	IRQn_I2C0   29 /* I2C0 IRQ */
#define	IRQn_I2C1   30 /* I2C1 IRQ */
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#define	IRQn_SPI0   33 /* SPI0 IRQ */
#define	IRQn_SPI1   34 /* SPI1 IRQ */
#define	IRQn_SPI2   35 /* SPI2 IRQ */
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#define	IRQn_MBX0A   38 /* MBX0A IRQ */
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#define	IRQn_ACMP1_1   57 /* ACMP1[1] IRQ */
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#define	IRQn_ACMP2_1   59 /* ACMP2[1] IRQ */
#define	IRQn_ACMP3_0   60 /* ACMP3[0] IRQ */
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#define	IRQn_MCAN0   66 /* MCAN0 IRQ */
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#define	IRQn_TRGMUX0   85 /* TRGMUX0 IRQ */
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#define	IRQn_NTMR0   88 /* NTMR0 IRQ */
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#define	IRQn_XPI0   90 /* XPI0 IRQ */
#define	IRQn_XDMA   93 /* XDMA IRQ */
#define	IRQn_SDP   95 /* SDP IRQ */
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#define	IRQn_PSEC   97 /* PSEC IRQ */
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#define	IRQn_PUART   101 /* PUART IRQ */
#define	IRQn_FUSE   102 /* FUSE IRQ */
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#define	IRQn_PAD_WAKEUP   104 /* PAD_WAKEUP IRQ */
#define	IRQn_BROWNOUT   105 /* BROWNOUT IRQ */
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#define	IRQn_CPU0   107 /* CPU0 IRQ */
#define	IRQn_CPU1   108 /* CPU1 IRQ */
#define	IRQn_DEBUG0   109 /* DEBUG0 IRQ */
#define	IRQn_DEBUG1   110 /* DEBUG1 IRQ */

Macro Definition Documentation

IRQn_ACMP0_0

#define IRQn_ACMP0_0   54 /* ACMP0[0] IRQ */

IRQn_ACMP0_1

#define IRQn_ACMP0_1   55 /* ACMP0[1] IRQ */

IRQn_ACMP1_0

#define IRQn_ACMP1_0   56 /* ACMP1[0] IRQ */

IRQn_ACMP1_1

#define IRQn_ACMP1_1   57 /* ACMP1[1] IRQ */

IRQn_ACMP2_0

#define IRQn_ACMP2_0   58 /* ACMP2[0] IRQ */

IRQn_ACMP2_1

#define IRQn_ACMP2_1   59 /* ACMP2[1] IRQ */

IRQn_ACMP3_0

#define IRQn_ACMP3_0   60 /* ACMP3[0] IRQ */

IRQn_ACMP3_1

#define IRQn_ACMP3_1   61 /* ACMP3[1] IRQ */

IRQn_ADC0

#define IRQn_ADC0   48 /* ADC0 IRQ */

IRQn_ADC1

#define IRQn_ADC1   49 /* ADC1 IRQ */

IRQn_ADC2

#define IRQn_ADC2   50 /* ADC2 IRQ */

IRQn_BROWNOUT

#define IRQn_BROWNOUT   105 /* BROWNOUT IRQ */

IRQn_CLC0_0

#define IRQn_CLC0_0   83 /* CLC0[0] IRQ */

IRQn_CLC0_1

#define IRQn_CLC0_1   84 /* CLC0[1] IRQ */

IRQn_CPU0

#define IRQn_CPU0   107 /* CPU0 IRQ */

IRQn_CPU1

#define IRQn_CPU1   108 /* CPU1 IRQ */

IRQn_DAC0

#define IRQn_DAC0   52 /* DAC0 IRQ */

IRQn_DAC1

#define IRQn_DAC1   53 /* DAC1 IRQ */

IRQn_DEBUG0

#define IRQn_DEBUG0   109 /* DEBUG0 IRQ */

IRQn_DEBUG1

#define IRQn_DEBUG1   110 /* DEBUG1 IRQ */

IRQn_EWDG0

#define IRQn_EWDG0   42 /* EWDG0 IRQ */

IRQn_EWDG1

#define IRQn_EWDG1   43 /* EWDG1 IRQ */

IRQn_FUSE

#define IRQn_FUSE   102 /* FUSE IRQ */

IRQn_GPIO0_A

#define IRQn_GPIO0_A   1 /* GPIO0_A IRQ */

IRQn_GPIO0_B

#define IRQn_GPIO0_B   2 /* GPIO0_B IRQ */

IRQn_GPIO0_C

#define IRQn_GPIO0_C   3 /* GPIO0_C IRQ */

IRQn_GPIO0_D

#define IRQn_GPIO0_D   4 /* GPIO0_D IRQ */

IRQn_GPIO0_X

#define IRQn_GPIO0_X   5 /* GPIO0_X IRQ */

IRQn_GPIO0_Y

#define IRQn_GPIO0_Y   6 /* GPIO0_Y IRQ */

IRQn_GPIO1_A

#define IRQn_GPIO1_A   7 /* GPIO1_A IRQ */

IRQn_GPIO1_B

#define IRQn_GPIO1_B   8 /* GPIO1_B IRQ */

IRQn_GPIO1_C

#define IRQn_GPIO1_C   9 /* GPIO1_C IRQ */

IRQn_GPIO1_D

#define IRQn_GPIO1_D   10 /* GPIO1_D IRQ */

IRQn_GPIO1_X

#define IRQn_GPIO1_X   11 /* GPIO1_X IRQ */

IRQn_GPIO1_Y

#define IRQn_GPIO1_Y   12 /* GPIO1_Y IRQ */

IRQn_GPTMR0

#define IRQn_GPTMR0   13 /* GPTMR0 IRQ */

IRQn_GPTMR1

#define IRQn_GPTMR1   14 /* GPTMR1 IRQ */

IRQn_GPTMR2

#define IRQn_GPTMR2   15 /* GPTMR2 IRQ */

IRQn_GPTMR3

#define IRQn_GPTMR3   16 /* GPTMR3 IRQ */

IRQn_HDMA

#define IRQn_HDMA   46 /* HDMA IRQ */

IRQn_I2C0

#define IRQn_I2C0   29 /* I2C0 IRQ */

IRQn_I2C1

#define IRQn_I2C1   30 /* I2C1 IRQ */

IRQn_I2C2

#define IRQn_I2C2   31 /* I2C2 IRQ */

IRQn_LOBS

#define IRQn_LOBS   47 /* LOBS IRQ */

IRQn_MBX0A

#define IRQn_MBX0A   38 /* MBX0A IRQ */

IRQn_MBX0B

#define IRQn_MBX0B   39 /* MBX0B IRQ */

IRQn_MBX1A

#define IRQn_MBX1A   40 /* MBX1A IRQ */

IRQn_MBX1B

#define IRQn_MBX1B   41 /* MBX1B IRQ */

IRQn_MCAN0

#define IRQn_MCAN0   66 /* MCAN0 IRQ */

IRQn_MCAN1

#define IRQn_MCAN1   67 /* MCAN1 IRQ */

IRQn_MTG0

#define IRQn_MTG0   81 /* MTG0 IRQ */

IRQn_NTMR0

#define IRQn_NTMR0   88 /* NTMR0 IRQ */

IRQn_PAD_WAKEUP

#define IRQn_PAD_WAKEUP   104 /* PAD_WAKEUP IRQ */

IRQn_PEWDG

#define IRQn_PEWDG   99 /* PEWDG IRQ */

IRQn_PGPIO

#define IRQn_PGPIO   98 /* PGPIO IRQ */

IRQn_PSEC

#define IRQn_PSEC   97 /* PSEC IRQ */

IRQn_PTMR

#define IRQn_PTMR   100 /* PTMR IRQ */

IRQn_PTPC

#define IRQn_PTPC   70 /* PTPC IRQ */

IRQn_PUART

#define IRQn_PUART   101 /* PUART IRQ */

IRQn_PWM0

#define IRQn_PWM0   73 /* PWM0 IRQ */

IRQn_PWM1

#define IRQn_PWM1   74 /* PWM1 IRQ */

IRQn_PWM2

#define IRQn_PWM2   75 /* PWM2 IRQ */

IRQn_QEI0

#define IRQn_QEI0   71 /* QEI0 IRQ */

IRQn_QEI1

#define IRQn_QEI1   72 /* QEI1 IRQ */

IRQn_RDC0

#define IRQn_RDC0   77 /* RDC0 IRQ */

IRQn_RNG

#define IRQn_RNG   96 /* RNG IRQ */

IRQn_SDM0

#define IRQn_SDM0   78 /* SDM0 IRQ */

IRQn_SDP

#define IRQn_SDP   95 /* SDP IRQ */

IRQn_SECMON

#define IRQn_SECMON   103 /* SECMON IRQ */

IRQn_SEI0_0

#define IRQn_SEI0_0   79 /* SEI0[0] IRQ */

IRQn_SEI0_1

#define IRQn_SEI0_1   80 /* SEI0[1] IRQ */

IRQn_SPI0

#define IRQn_SPI0   33 /* SPI0 IRQ */

IRQn_SPI1

#define IRQn_SPI1   34 /* SPI1 IRQ */

IRQn_SPI2

#define IRQn_SPI2   35 /* SPI2 IRQ */

IRQn_SYSCTL

#define IRQn_SYSCTL   106 /* SYSCTL IRQ */

IRQn_TRGMUX0

#define IRQn_TRGMUX0   85 /* TRGMUX0 IRQ */

IRQn_TRGMUX1

#define IRQn_TRGMUX1   86 /* TRGMUX1 IRQ */

IRQn_TSNS

#define IRQn_TSNS   37 /* TSNS IRQ */

IRQn_UART0

#define IRQn_UART0   21 /* UART0 IRQ */

IRQn_UART1

#define IRQn_UART1   22 /* UART1 IRQ */

IRQn_UART2

#define IRQn_UART2   23 /* UART2 IRQ */

IRQn_UART3

#define IRQn_UART3   24 /* UART3 IRQ */

IRQn_USB0

#define IRQn_USB0   89 /* USB0 IRQ */

IRQn_VSC0

#define IRQn_VSC0   82 /* VSC0 IRQ */

IRQn_XDMA

#define IRQn_XDMA   93 /* XDMA IRQ */

IRQn_XPI0

#define IRQn_XPI0   90 /* XPI0 IRQ */